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版权信息
前言
第1章 EDA技术概述
1.1 EDA技术及其发展
1.2 Top-down设计与IP核复用
1.3 数字设计的流程
1.4 常用的EDA软件工具
1.5 EDA技术的发展趋势
习题1
第2章 FPGA/CPLD器件
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2.1 PLD器件概述
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2.2 PLD的基本原理与结构
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2.3 低密度PLD的原理与结构
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2.4 CPLD的原理与结构
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2.5 FPGA的原理与结构
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2.6 FPGA/CPLD的编程元件
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2.7 边界扫描测试技术
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2.8 FPGA/CPLD的编程与配置
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2.9 FPGA/CPLD器件概述
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2.10 FPGA/CPLD的发展趋势
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习题2
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第3章 Quartus Ⅱ集成开发工具
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3.1 Quartus Ⅱ原理图设计
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3.2 Quartus Ⅱ的优化设置
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3.3 Quartus Ⅱ的时序分析
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3.4 基于宏功能模块的设计
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习题3
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第4章 VHDL设计初步
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4.1 VHDL简介
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4.2 VHDL组合电路设计
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4.3 VHDL时序电路设计
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4.4 Synplify Pro综合器
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4.5 Synplify综合器
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习题4
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第5章 VHDL结构与要素
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5.1 实体
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5.2 结构体
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5.3 VHDL库和程序包
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5.4 配置
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5.5 子程序
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5.6 VHDL文字规则
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5.7 数据对象
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5.8 VHDL数据类型
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5.9 VHDL运算符
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习题5
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第6章 VHDL基本语句
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6.1 顺序语句
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6.2 并行语句
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6.3 属性说明与定义语句
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习题6
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第7章 VHDL设计进阶
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7.1 行为描述
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7.2 数据流描述
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7.3 结构描述
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7.4 三态逻辑设计
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7.5 RAM存储器设计
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7.6 分频器设计
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7.7 数字跑表
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7.8 音乐演奏电路
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习题7
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第8章 有限状态机设计
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8.1 有限状态机
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8.2 有限状态机的描述方式
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8.3 状态编码
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8.4 有限状态机设计要点
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8.5 用状态机设计流水灯
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8.6 状态机A/D采样控制电路
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习题8
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第9章 VHDL数字设计与优化
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9.1 流水线设计技术
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9.2 资源共享
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9.3 字符液晶显示控制
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9.4 VGA图像显示控制器设计
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9.5 FIFO缓存器设计
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9.6 异步串行接口（UART）设计
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习题9
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第10章 VHDL数字电路的仿真
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10.1 VHDL仿真概述
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10.2 VHDL测试平台
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10.3 ModelSim仿真概述
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10.4 ModelSim仿真实例
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习题10
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第11章 DSP Builder设计初步
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11.1 DSP Builder设计流程
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11.2 DSP Builder设计示例
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11.3 建立DSP Builder子系统
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11.4 基于DSP Builder的数字AGC设计
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11.5 硬件在回路（HIL）仿真
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习题11
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第12章 VHDL通信与接口设计实例
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12.1 m序列发生器
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12.2 Gold码
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12.3 FSK解调
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12.4 数字过零检测法和等精度频率测量
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12.5 I2C总线接口设计
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习题12
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附录A VHDL关键字
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附录B VHDL程序包
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B.1 STANDARD程序包（STD库）
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B.2 Std_logic_1164程序包（IEEE库）
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附录C DE2-70系统介绍
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附录D DE2系统介绍
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附录E 有关术语与缩略语
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参考文献
更新时间：2018-12-27 20:10:44
完结共105章
倒序